FPGA - Arreglo de puerta programable de campo
10CL040YU484I7G
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Cyclone 10 LP 10CL040
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325 I/O
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1.2 V
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10CL040YU484A7G
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Cyclone 10 LP 10CL040
39600 LE
1.11 Mbit
325 I/O
1.2 V
1.2 V
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10CL040ZU484I8G
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Cyclone 10 LP 10CL040
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10CL040YU484C8G
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1.11 Mbit
325 I/O
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1.2 V
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10CL040YF484C6G
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39600 LE
1.11 Mbit
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1.2 V
1.2 V
0 C
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10CL040YU484C6G
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S/281.86
84 Se espera el 28/10/2026
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989-10CL040YU484C6G
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84 Se espera el 28/10/2026
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39600 LE
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1.2 V
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10CL040YF484C8G
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989-10CL040YF484C8G
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240 Se espera el 9/02/2027
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1.2 V
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10CL040YF484I7G
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159 Se espera el 11/01/2027
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989-10CL040YF484I7G
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159 Se espera el 11/01/2027
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39600 LE
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1.2 V
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10CL040ZF484I8G
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S/255.11
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989-10CL040ZF484I8G
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Cyclone 10 LP 10CL040
39600 LE
1.11 Mbit
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