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LMK5C33216ARGCT

Name: Texas Instruments LMK5C33216ARGCT
Brand: Texas Instruments
SKU: 595-LMK5C33216ARGCT
Price: 230.44 PEN
Availability: InStock

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Mouser N.º:

595-LMK5C33216ARGCT

Fabricante N.º:

LMK5C33216ARGCT

Fabricante:

Texas Instruments

Descripción:

Sintetizador de reloj / depurador de fluctuación Three DPLL three AP LL two-input and 16

Hoja de datos:

LMK5C33216ARGCT Hoja de datos

Modelo ECAD:

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Cantidad	Precio unitario	Precio ext.
	S/230.44	S/230.44
	S/195.01	S/1,950.10
	S/188.75	S/4,718.75
	S/188.67	S/9,433.50
	S/174.85	S/17,485.00
	S/155.70	S/38,925.00

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Sintetizador de reloj / depurador de fluctuación
RoHS:
Número de salidas:	16 Output
Frecuencia de salida máx.:	1.25 GHz
Nivel de salida:	CML, HSCL, LVCMOS, LVDS, LVPECL
Nivel de entrada:	Differential, Single-Ended
Paquete / Cubierta:	VQFN-64
Frecuencia de entrada máxima:	200 MHz, 800 MHz
Voltaje de alimentación - Mín.:	3.135 V
Voltaje de alimentación - Máx.:	3.465 V
Temperatura de trabajo mínima:	- 40 C
Temperatura de trabajo máxima:	+ 105 C
Serie:	LMK5C33216A
Estilo de montaje:	SMD/SMT
Marca:	Texas Instruments
Sensibles a la humedad:	Yes
Corriente de suministro operativa:	950 mA, 1.09 A, 1.205 A
Producto:	Synchronizers / Jitter Cleaners
Tipo de producto:	Clock Synthesizers / Jitter Cleaners
Cantidad de empaque de fábrica:	250
Subcategoría:	Clock & Timer ICs
Tipo:	High-Performance Network Synchronizer and Jitter Cleaner

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CAHTS:: 8542390000
USHTS:: 8542390090
MXHTS:: 8542399999
ECCN:: EAR99

LMK5C33216A High-Performance Network Synchronizer

Texas Instruments LMK5C33216A High-Performance Network Synchronizer includes a jitter cleaner designed to meet stringent wireless communications and infrastructure application requirements. The network synchronizer integrates three DPLLs to provide hitless jitter and switching attenuation with programmable loop bandwidth and no external loop filters. This feature maximizes the flexibility and ease of use of the device. Each DPLL phase locks a paired APLL to a reference input.