CDCU877ANMKT

Texas Instruments
595-CDCU877ANMKT
CDCU877ANMKT

Fabricante:

Descripción:
Emisores y distribución de reloj 1.8-V phase-lock loo p clock driver for A 595-CDCU877ANMKR

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S/-.--
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S/-.--
Est. Tarifa:
Empaque:
Envase tipo carrete completo (pedir en múltiplos de 250)

Precio (PEN)

Cantidad Precio unitario
Precio ext.
Cinta cortada / MouseReel™ †
S/41.61 S/41.61
S/32.50 S/325.00
S/30.21 S/755.25
S/27.71 S/2,771.00
Envase tipo carrete completo (pedir en múltiplos de 250)
S/26.31 S/6,577.50
S/25.34 S/12,670.00
S/24.95 S/24,950.00
2,500 Presupuesto
† S/23.00 Se agregará y calculará la tarifa de MouseReel™ en su carrito de compras. Ningún artículo de MouseReel™ se puede cancelar ni devolver. ↩

Embalaje alternativo

N.º de artículo del Fabricante:
CDCU877ANMKR
Embalaje:
Reel, Cut Tape, MouseReel
Disponibilidad:
En existencias
Precio:
S/35.62
Mín.:
1

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Atributo del producto Valor de atributo Seleccionar atributo
Texas Instruments
Categoría de producto: Emisores y distribución de reloj
RoHS:  
LVCMOS
340 MHz
LVCMOS
NFBGA-52
1.7 V
1.9 V
CDCU877A
- 40 C
+ 85 C
Reel
Cut Tape
MouseReel
Marca: Texas Instruments
Sensibles a la humedad: Yes
Estilo de montaje: SMD/SMT
Corriente de suministro operativa: 500 uA
Producto: Clock Drivers
Tipo de producto: Clock Drivers & Distribution
Cantidad de empaque de fábrica: 250
Subcategoría: Clock & Timer ICs
Tipo: Phase Lock Loop Clock Driver
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Atributos seleccionados: 0

Hoja de datos

Application Notes

PCN

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USHTS:
8542310075
ECCN:
EAR99

CDCU877 Phase-Lock Loop Clock Driver

Texas Instruments CDCU877 Phase-Lock Loop Clock Driver is a high-performance, low-jitter, low-skew, zero-delay buffer. It distributes a differential clock input pair (CK, /CK) to 10 differential pairs of clock outputs (Yn, /Yn) and one differential pair of feedback clock outputs (FBOUT, /FBOUT). The clock outputs are controlled by the input clocks (CK, /CK), the feedback clocks (FBIN, /FBIN), the LVCMOS control pins (OE, OS), and the analog power input (AVDD). When OE is low, the clock outputs, except FBOUT, /FBOUT, are disabled while the internal PLL maintains its locked-in frequency. OS (output select) is a program pin that must be tied to GND or VDD. When OS is high, OE functions as previously described. When OS and OE are both low, OE does not affect Y7, /Y7, as these are free-running. When AVDD is grounded, the PLL is turned off and bypassed for test purposes.

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