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CDCU2A877NMKT

Name: Texas Instruments CDCU2A877NMKT
Brand: Texas Instruments
SKU: 595-CDCU2A877NMKT
Price: 36.32 PEN
Availability: InStock

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Mouser N.º:

595-CDCU2A877NMKT

Fabricante N.º:

CDCU2A877NMKT

Fabricante:

Texas Instruments

Descripción:

Emisores y distribución de reloj 1.8-V phase-lock loo p clock driver with A 595-CDCU2A877NMKR

Hoja de datos:

CDCU2A877NMKT Hoja de datos

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Empaque:

Envase tipo carrete completo (pedir en múltiplos de 250)

Cinta cortada

MouseReel™ (+S/23.00)

Precio (PEN)

Cantidad	Precio unitario	Precio ext.
Cinta cortada / MouseReel™ ^†
	S/36.32	S/36.32
	S/28.30	S/283.00
	S/26.27	S/656.75
	S/24.06	S/2,406.00
Envase tipo carrete completo (pedir en múltiplos de 250)
	S/22.97	S/5,742.50
	S/22.03	S/11,015.00
	S/21.45	S/21,450.00

† S/23.00 Se agregará y calculará la tarifa de MouseReel™ en su carrito de compras. Ningún artículo de MouseReel™ se puede cancelar ni devolver. ↩

Embalaje alternativo

N.º de artículo del Fabricante:

CDCU2A877NMKR

Embalaje:

Reel, Cut Tape, MouseReel

Disponibilidad:

En existencias

Precio:

S/36.98

Mín.:

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Texas Instruments

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CDCU2A877NMKR

Descripción:

Emisores y distribución de reloj 1.8-V phase-lock loo p clock driver with A 595-CDCU2A877NMKT

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Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Emisores y distribución de reloj
RoHS:
Serie:	CDCU2A877
Empaquetado:	Reel
Empaquetado:	Cut Tape
Empaquetado:	MouseReel
Marca:	Texas Instruments
Sensibles a la humedad:	Yes
Producto:	Clock Drivers
Tipo de producto:	Clock Drivers & Distribution
Cantidad de empaque de fábrica:	250
Subcategoría:	Clock & Timer ICs

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USHTS:: 8542310075
ECCN:: EAR99

CDCU2A877 Phase-Lock Loop Clock Driver

Texas Instruments CDCU2A877 Phase-Lock Loop Clock Driver is a high-performance, low-jitter, low-skew, zero-delay buffer. It distributes a differential clock input pair (CK, /CK) to 10 differential pairs of clock outputs (Yn, /Yn) and one differential pair of feedback clock outputs (FBOUT, /FBOUT). The clock outputs are controlled by the input clocks (CK, /CK), the feedback clocks (FBIN, /FBIN), the LVCMOS control pins (OE, OS), and the analog power input (AV_DD). When OE is low, the clock outputs, except FBOUT, /FBOUT, are disabled while the internal PLL maintains its locked-in frequency. OS (output select) is a program pin that must be tied to GND or V_DD. When OS is high, OE functions as previously described. When OS and OE are both low, OE does not affect Y7, /Y7, as these are free-running. When AV_DD is grounded, the PLL is turned off and bypassed for test purposes.