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SATA3H-CPUless-IP-VT7

Name: Design Gateway SATA3H-CPUless-IP-VT7
Brand: Design Gateway
SKU: 408-CPULESS-IP-VT7
Price: 156455.38 PEN
Availability: OutOfStock

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Mouser N.º:

408-CPULESS-IP-VT7

Fabricante N.º:

SATA3H-CPUless-IP-VT7

Fabricante:

Design Gateway

Descripción:

Software de desarrollo CPU less SATA Host IP core for Xilinx Virtex-7

Hoja de datos:

SATA3H-CPUless-IP-VT7 Hoja de datos (PDF)

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	S/156,455.38	S/156,455.38

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Design Gateway
Categoría de producto:	Software de desarrollo
Producto:	IP Core - SATA3H-CL
Para utilizar con:	Xilinx Virtex-7
Marca:	Design Gateway
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	Not Available
Tipo de producto:	Development Software
Subcategoría:	Embedded Solutions

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SATA3H-CPUless-IP-VT7 Hoja de datos (PDF)

SATA3 Host CPUless IP Core

Design Gateway SATA3 Host CPUless IP Core is designed to be an all-in-one system containing the application, transport, and link layers in one IP. This helps the connection with the PHY layer implemented by the transceiver without CPU and DDR usage. The SATA Physical layer is designed using an HDL code to control the transceiver following the SATA protocol. The interface module is connected between the SATA3H-CL IP and the SATA device. This SATA3 IP core PHY is provided in the reference design in the release stuff for the IP customer. The SATA3 host IP core features a dgIF typeS user interface that is very easy to access and comes with a control and data interface.